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基于Verilog语言设计的SDRAM控制器

  • 更新：2024-07-21 14:18:38
  • 大小：3.36MB
  • 推荐：★★★★★
  • 来源：网友上传分享
  • 类别：硬件开发 - 开发技术
  • 格式：RAR
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资源介绍

实验条件： 工具：Quartus II 6.0 , SignalTap II FPGA：Altera Cyclone EP1C12Q240C8N SDRAM：HY57V283220T-6
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