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2008年提出的一种新型H. 264/AVC标量量化并行VLSI结构
资源介绍
针对H.264视频编码标准关键技术52级标量量化的VLSI实现过程中，传统结构的速度和面积不能有效满足H.264在高速高并行编码应用中的实时要求，通过采用部分CSD码无符号压缩移位加法树、参考电平连线、对量化系数和步长重新进行分组分段编码等方法，有效替代了H.264标量量化过程中出现的矩阵乘法、查表、除法等不利于硬件加速的算法，提出了一种非常适合流水加速的基于4×4块并行的VLSI结构，通过控制级联加法器级数就可以有效调节其速度性能，当级数为2时，其块处理速率可以达到121.6MHz，能够满足4096×2
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