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FPGA浮点乘法器的源代码

更新：2024-11-17 11:07:32
大小：2KB
推荐：★★★★★
来源：网友上传分享
类别：硬件开发 - 开发技术
格式：RAR

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verilog 语言写的FPGA内部实现硬件浮点乘法器的源码，两个时钟周期完成一次浮点乘法运算，里面调用了一个xilinx的定点乘法器IP核，因不同的FPGA芯片其定点乘法器IP核可能不同，所以本例子不包含该IP核的源码，请根据自己的硬件平台，自行生成32bit的定点乘法器IP,然后才能调试本例。如有疑问，请加我QQ:898975448

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